可重构系统中快速高斯消元算法的并行硬件体系实现



可重构系统中快速高斯消元算法的并行硬件体系实现

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可重构系统中快速高斯消元算法的并行硬件体系实现

论文目录
摘要	第1-6页
Abstract	第6-10页
第1章绪论	第10-17页
· 背景与研究意义	第10-12页
· 国内外研究现状与相关技术发展	第12-14页
· 国内外研究现状	第12-14页
· FPGA技术的发展	第14页
· 研究内容与创新点	第14-16页
· 研究内容	第14-15页
· 创新点	第15-16页
· 论文的组织结构	第16-17页
第2章可重构计算技术相关介绍	第17-26页
· 可重构计算系统结构	第17-22页
· 系统级结构	第17-18页
· 可重构逻辑的结构	第18-20页
· 可重构逻辑的互连	第20-22页
· 可重构计算技术的特点与应用	第22-24页
· 可重构计算技术的特点	第22页
· 可重构计算技术的应用领域	第22-24页
· 可重构计算技术中其他热点问题	第24-25页
· 重构方法	第24页
· 高级程序语言到硬件描述语言的转换	第24-25页
· 可重构系统的任务调度	第25页
· 本章小结	第25-26页
第3章高斯消元原理与算法优化	第26-36页
· 高斯消元原理	第26-29页
· 常规高斯消元	第26-28页
· GF(2)域上的高斯消元	第28-29页
· 高斯消元算法分析与优化	第29-34页
· 算法分析	第29-31页
· 算法优化	第31-34页
· 优化后性能分析	第34-35页
· GF(2)域上的高斯消元	第34-35页
· 普通高斯消元	第35页
· 本章小结	第35-36页
第4章 GF(2)域上的高斯消元并行硬件体系设计与分析	第36-48页
· 设计概述	第36页
· 基本位单元设计	第36-38页
· 并行结构设计	第38-40页
· 硬件体系设计	第38-39页
· 系统工作过程	第39-40页
· 测试与分析	第40-47页
· EDA工具与测试流程	第40-42页
· 仿真与综合结果	第42-45页
· 性能分析	第45-47页
· 本章小结	第47-48页
第5章 32位单精度浮点高斯消元并行设计与分析	第48-66页
· 设计概述	第48-49页
· 总体设计思路	第48页
· 浮点带来的问题	第48-49页
· FPLibrary浮点库	第49-53页
· FPLibrary简介与可行性测试	第49-53页
· FPLibrary的使用	第53页
· 基本单元设计	第53-55页
· 并行结构设计	第55-59页
· 硬件体系设计	第55-57页
· 系统工作过程	第57-59页
· 测试与分析	第59-65页
· 仿真与综合结果	第59-62页
· 性能分析	第62-65页
· 本章小结	第65-66页
第6章在可重构计算系统中的实现与验证	第66-77页
· 基于PCI-E的可重构计算模型简介	第66-67页
· 可重构计算模型系统的实现	第67-73页
· 硬件平台	第67-70页
· 系统的控制与调度	第70-73页
· 在可重构计算模型中的验证	第73-76页
· 本章小结	第76-77页
结论	第77-78页
参考文献	第78-90页
攻读硕士学位期间发表的论文及取得的科研成果	第90-91页
致谢	第91页

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