DVI接收端模拟部分电路研究与实现



DVI接收端模拟部分电路研究与实现

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DVI接收端模拟部分电路研究与实现

论文目录
摘要	第1-6页
Abstract	第6-10页
第1章绪论	第10-15页
· 视频技术发展过程	第10-11页
· DVI 技术发展现状和研究意义	第11-13页
· 锁相环技术的发展历程和研究意义	第13-14页
· 论文研究内容及安排	第14-15页
第2章 DVI 标准和 DVI 接收端设计规划	第15-22页
· DVI 接口标准	第15-18页
· DVI 系统结构	第18-19页
· DVI 接收端模拟部分电路设计规划	第19-21页
· 本章小结	第21-22页
第3章高速差分接收单元	第22-28页
· 高速差分接收单元电路设计	第22-25页
· 放大器电路设计	第22-23页
· 电平转换电路设计	第23-25页
· 高速差分接收单元电路仿真	第25-27页
· 本章小结	第27-28页
第4章 3 倍过采样数据恢复电路	第28-41页
· 过采样技术简介	第28-29页
· 过采样数据恢复电路逻辑设计	第29-39页
· 采样电路设计	第29-30页
· 相位检测电路设计	第30-34页
· 移相调节电路设计	第34-39页
· 数据恢复电路系统仿真	第39-40页
· 本章小结	第40-41页
第5章 12 相等相位差时钟输出电荷泵锁相环	第41-73页
· 锁相环简介	第41-43页
· 锁相环的工作原理	第41-42页
· 锁相环的工作状态	第42-43页
· 电荷泵锁相环的建模和仿真	第43-47页
· 电荷泵锁相环的数学模型	第43-46页
· 电荷泵锁相环的 Simulink 建模和仿真	第46-47页
· 锁相环的噪声和抖动	第47-51页
· 锁相环中的主要噪声源	第48-49页
· 电荷泵锁相环的噪声模型	第49-50页
· 锁相环输出时钟的抖动	第50-51页
· PLL 电路设计	第51-69页
· 鉴频鉴相器设计	第51-55页
· 电荷泵电路设计	第55-60页
· 环路滤波器设计	第60-61页
· 压控振荡器设计	第61-67页
· 其他电路设计	第67-69页
· PLL 系统仿真	第69-72页
· 本章小结	第72-73页
第6章 DVI 接收端模拟电路系统仿真及版图实现	第73-81页
· 系统前仿真	第73-75页
· 版图设计及其后仿真	第75-80页
· 版图设计	第75-78页
· 系统后仿真	第78-80页
· 本章小结	第80-81页
结论	第81-84页
参考文献	第84-87页
致谢	第87-88页
附录 A 攻读学位期间所发表的学术论文目录	第88页

本篇论文共88页，点击这进入下载页面。

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