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基于冒险分析的低功耗设计和基于测试的设计验证

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基于冒险分析的低功耗设计和基于测试的设计验证
论文目录
 
声明第1 页
关于论文使用授权的说明第3-4 页
摘 要第4-5 页
Abstract第5-10 页
第一章 引言第10-14 页
  · 集成电路低功耗设计第10-11 页
  · 集成电路中冒险的检测和消除第11-12 页
  · 集成电路的设计验证第12 页
  · 本文的内容和章节安排第12-13 页
  · 小结第13-14 页
第二章 冒险检测和消除的基础第14-20 页
  · 电路中的跳变和冒险第14-15 页
  · CMOS 电路由于冒险造成的功耗第15-16 页
  · 信号延迟和门延迟模型第16-18 页
    · 时钟采样消除电路中冒险的影响第16-17 页
    · 信号延迟和门延迟模型第17-18 页
  · 基本术语第18-19 页
  · 小结第19-20 页
第三章 原始输入单跳变导致的冒险的检测和消除第20-36 页
  · 标记电路元素第20-23 页
    · 标记电路元素的方法第20-21 页
    · 一个标记电路的例子第21-23 页
  · 检测单原始输入跳变导致的冒险第23-24 页
    · 检测单原始输入跳变导致的冒险的原理第23-24 页
    · 检测原始输入单跳变导致的冒险的方法第24 页
  · 消除或减少单原始输入跳变导致的冒险第24-25 页
    · 消除或减少单原始输入跳变导致的冒险的原理第24 页
    · 消除或减少单原始输入跳变导致的冒险的方法第24-25 页
  · 消除或减少单原始输入跳变导致的冒险的具体步骤第25-27 页
    · 在有尖峰脉冲的电路元素的标记中加入增量第25 页
    · 依倒序逐一在其它电路元素的标记中加入增量第25-26 页
    · 检测并标记“固定”元素第26 页
    · 计算每一元素标记中Mul 之和第26 页
    · 在TotalMul 最大的元素上增加延迟时间第26-27 页
  · 消除或减少单原始输入跳变导致的冒险的例子第27-29 页
  · 检测和消除单原始输入跳变导致的冒险的的实现第29-32 页
    · 算法框架第29-31 页
    · 检测和减少单原始输入跳变导致的冒险的实现第31-32 页
  · 实验结果及分析第32-34 页
  · 小结第34-36 页
第四章 原始输入多跳变导致的冒险的检测和消除第36-46 页
  · 多个原始输入跳变导致的冒险的原理第36 页
  · 通路长度矩阵第36-37 页
  · 原始输入多跳变导致的冒险的检测方法第37-40 页
    · 原始输入多跳变导致的冒险的检测方法第37-38 页
    · 一个检测多个原始输入跳变导致冒险的例子第38-40 页
    · 实验结果和分析第40 页
  · 通过增加门延迟过滤掉冒险的方法第40-41 页
    · 在产生冒险的门处直接增加门延迟过滤掉冒险的方法第40 页
    · 实验结果和分析第40-41 页
  · 通过逐级调整电路来减少电路冒险的方法第41-43 页
    · 通过逐级调整电路来减少电路冒险的方法第41-42 页
    · 实验结果和分析第42-43 页
  · 小结第43-46 页
第五章 集成电路设计验证的基础第46-54 页
  · 逻辑设计验证的方法概述第46-47 页
  · 设计错误及其检测第47-52 页
    · 门替换错误和固定型故障测试第47 页
    · 多余反相器错误第47-48 页
    · 多余的连线第48-49 页
    · 多余门错误第49 页
    · 漏掉一个门第49 页
    · 漏掉一个反相器第49-50 页
    · 漏掉一个门的输入端第50 页
    · 连线错误第50-51 页
    · 较复杂的多余门错误第51 页
    · 较复杂的漏掉一个门的错误第51-52 页
  · 关于假设条件的几点讨论第52-53 页
    · 关于设计中错误的类型第52 页
    · 设计过程中只有一个错误第52-53 页
    · 含有异或门和异或非门的电路第53 页
    · 关于完全测试集第53 页
  · 本章小结第53-54 页
第六章 基于测试的设计验证实践第54-64 页
  · 测试产生第54-56 页
    · 故障模型第54-55 页
    · 测试产生第55 页
    · 故障覆盖率第55-56 页
  · 测试产生工具第56-57 页
    · 测试产生工具SynTest第56-57 页
    · 测试产生工具HITEC第57 页
  · 设计验证的激励生成方法第57-60 页
    · 电路综合第58-59 页
    · 电路格式转换第59 页
    · 测试产生第59-60 页
  · 测试产生结果第60-62 页
  · 芯片设计的冗余度检查第62-63 页
    · 通用寄存器模块的冗余度分析第62-63 页
    · ALU 模块的冗余度分析第63 页
  · 小结第63-64 页
第七章 总结第64-66 页
参考文献第66-70 页
致谢第70-72 页
作者简历第72页

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