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AES加密算法及其错误检测的硬件实现
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AES加密算法及其错误检测的硬件实现
论文目录
 
摘要第1-4页
Abstract第4-10页
第一章 引言第10-16页
　　· 课题研究背景第10-12页
　　　　· 数据加密标准的发展第10页
　　　　· FPGA的特点第10-11页
　　　　· 国内外研究现状第11-12页
　　· 研究意义及目的第12-13页
　　· 论文的工作内容第13-14页
　　· 论文的组织结构第14-16页
第二章 密码学概要第16-26页
　　· 网络信息保密的意义第16页
　　· 密码学相关概念第16页
　　· 密码系统第16-18页
　　　　· 密码系统的定义第16-17页
　　　　· 密码系统安全的条件第17-18页
　　　　· 密码系统的分类第18页
　　· 网络安全模型第18-19页
　　· 密码体制第19-21页
　　　　· 对称密码体制第19-20页
　　　　· 非对称密码体制第20-21页
　　· 密钥管理第21-24页
　　　　· 密钥的生成与安全存储第21-22页
　　　　　　· 密钥的生成第21-22页
　　　　　　· 密钥的安全存储第22页
　　　　· 密钥的协商与分发第22-24页
　　　　　　· 秘密密钥的分发第23页
　　　　　　· 公开密钥的分发第23-24页
　　· 关于AES第24-26页
第三章 AES加密算法第26-34页
　　· AES介绍第26-27页
　　· AES算法说明第27-31页
　　　　· 状态、密钥和轮数第27-28页
　　　　· 轮函数第28-31页
　　　　　　· 字节代换(SubBytes)第28-29页
　　　　　　· 行移位(ShiftRows)第29-30页
　　　　　　· 列混合(MixColumns)第30-31页
　　　　　　· 密钥加(AddRoundKey)第31页
　　· 密钥编排第31-33页
　　· 算法性能解析第33-34页
第四章 差错控制编码第34-41页
　　· 差错控制的基本概念第34页
　　· 线性分组码第34-36页
　　· 循环码第36-37页
　　· 循环冗余校验(CRC)码第37-41页
　　　　· CRC的分类第37-38页
　　　　· CRC的原理简介第38-41页
　　　　　　· CRC生成基本理论第38-39页
　　　　　　· CRC产生的操作过程第39-40页
　　　　　　· CRC检验基本理论第40-41页
第五章 开发环境介绍第41-51页
　　· 系统开发环境第41-45页
　　　　· 硬件开发平台第41-42页
　　　　· 软件开发工具第42-45页
　　· 硬件描述语言HDL第45-49页
　　　　· VHDL第46页
　　　　· Verilog HDL第46-49页
　　　　· 两种语言的比较第49页
　　· 仿真的概念与ModelSim仿真工具第49-51页
　　　　· 仿真简介第49-50页
　　　　· ModelSim仿真工具第50-51页
第六章 高级加密标准的FPGA设计第51-63页
　　· AES加解密系统的实现方式第51页
　　· 总体设计方案第51-52页
　　· AES加解密系统的基本结构第52-55页
　　　　· AES加密模块结构第54页
　　　　· AES解密模块结构第54-55页
　　· AES加解密结构设计第55-63页
　　　　· AES加密结构设计第55-58页
　　　　· AES加密结构设计性能分析第58-59页
　　　　· AES解密结构设计第59-61页
　　　　· AES解密结构设计性能分析第61-63页
第七章 CRC算法的FPGA设计第63-68页
　　· 比特型算法第63页
　　· 比特型算法的仿真第63页
　　· 查表型算法第63-64页
　　· 查表型算法的仿真第64页
　　· 并行数据算法第64-65页
　　· 并行算法的仿真第65-68页
第八章 总结第68-69页
　　· 结论第68页
　　· 展望第68-69页
致谢第69-70页
参考文献第70-73页
附录 攻读硕士学位期间完成的主要论文第73 页

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