基于NAND flash主控制器的BCH纠错算法设计与实现



基于NAND flash主控制器的BCH纠错算法设计与实现

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基于NAND flash主控制器的BCH纠错算法设计与实现

论文目录
摘要	第1-5页
Abstract	第5-9页
第1章绪论	第9-20页
· 课题背景及研究的目的和意义	第9-10页
· 国内外研究发展现状分析	第10-19页
· NAND flash 研究发展概述	第10-16页
· NAND flash ECC 纠错算法研究发展现状	第16-19页
· 本文主要内容及结构	第19-20页
第2章 BCH 纠错算法研究及验证	第20-36页
· BCH 纠错算法研究	第20-30页
· 有限域概述及构造	第20-21页
· 线性分组码和循环码	第21-24页
· 二进制 BCH 算法参数意义及选取	第24-26页
· BCH 编码过程	第26-27页
· BCH 译码过程	第27-30页
· BCH 算法功能验证	第30-34页
· 软件算法功能特性	第30-31页
· 功能验证步骤	第31-32页
· 算法功能验证实例	第32-34页
· 设计优化	第34-35页
· 本章小结	第35-36页
第3章 BCH 纠错算法固件设计	第36-50页
· BCH 编码器固件设计	第36-41页
· 参数选取分析	第36-37页
· 32 位并行编码器设计	第37-39页
· 编码器的逻辑实现	第39-41页
· BCH 译码器固件设计	第41-49页
· 有限域的构建	第41-43页
· 译码器的逻辑实现	第43-49页
· 本章小结	第49-50页
第4章固件 BCH 纠错算法测试	第50-65页
· 验证平台搭建	第50-53页
· 验证平台结构概述	第50-51页
· 基于 Zynq 的固件验证架构	第51-53页
· 测试方法及过程	第53-54页
· 固件仿真测试	第54-56页
· 实物纠错能力测试	第56-61页
· 基于 P/E(PROGRAM/ERASE 编程擦除次数)纠错能力测试	第56-59页
· 基于存储时间纠错能力测试	第59-61页
· I/O 读写速度变化率测试	第61-63页
· NAND flash 写入速度变化率测试	第61-62页
· NAND flash 读取速度变化率测试	第62-63页
· 逻辑资源使用情况测试	第63-64页
· 本章小结	第64-65页
结论	第65-66页
参考文献	第66-71页
致谢	第71页

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