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CPCI-E总线增强型GJB289A/1553B模块研制
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CPCI-E总线增强型GJB289A/1553B模块研制
论文目录
 
摘要第1-5页
Abstract第5-9页
第1章 绪论第9-16页
　　· 课题的来源及研究目的和意义第9-10页
　　· 国内外研究现状分析第10-15页
　　　　· 国外研究现状第10页
　　　　· 国内研究现状第10-12页
　　　　· 关键技术概况第12-15页
　　· 本文主要研究内容及结构第15-16页
第2章 总体方案设计第16-27页
　　· 主要技术指标第16页
　　· 1553B 总线技术研究第16-20页
　　　　· 1553B 总线拓扑结构第16-17页
　　　　· 1553B 总线数据编码格式和数据格式第17-19页
　　　　· 1553B 的消息传输方式第19-20页
　　· 硬件设计方案第20-25页
　　　　· 硬件总体方案框图第20-22页
　　　　· 1553B 通讯接口方案第22页
　　　　· 主处理器方案第22-23页
　　　　· 上位机接口方案第23-24页
　　　　· 固态存储器功能单元方案第24-25页
　　· 软件设计方案第25-26页
　　· 本章小结第26-27页
第3章 硬件设计第27-58页
　　· 1553B 通讯单元设计第27-38页
　　　　· 1Mbps 标准速率 1553B 单元第27-36页
　　　　· 4Mbps 高速 1553B 单元第36-38页
　　· 固态存储器功能单元设计第38-48页
　　　　· 硬件电路设计第38-39页
　　　　· DDR3 内存基本结构第39页
　　　　· DDR3 SDRAM 的工作状态机第39-44页
　　　　· 硬核 DDR3 控制接口第44-48页
　　· 上位机接口单元设计第48-57页
　　　　· CPCI-E 规范第49-51页
　　　　· 硬核 CPCI-E 控制接口第51-57页
　　· 本章小结第57-58页
第4章 软件设计第58-70页
　　· DSP 控制程序第58-64页
　　　　· DSP 软件功能需求第58页
　　　　· DSP 程序结构和流程第58-60页
　　　　· 1553B 的 BC、RT 及 MT 操作第60-64页
　　· 上位机应用程序第64-69页
　　　　· 上位机软件功能需求第64-65页
　　　　· 应用程序设计第65-68页
　　　　· 驱动程序设计第68-69页
　　· 本章小结第69-70页
第5章 测试第70-77页
　　· 测试平台搭建第70-71页
　　· 测试方法及结果第71-76页
　　　　· CPCI-E 接口和 DDR3 测试第71-72页
　　　　· 1553B 通讯测试第72-76页
　　· 本章小结第76-77页
结论第77-78页
参考文献第78-81页
攻读学位期间发表的学术论文第81-83页
致谢第83页

本篇论文共83页，点击这进入下载页面。
 
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