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DDS/PLL相结合的低相噪频率合成器的研究
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DDS/PLL相结合的低相噪频率合成器的研究
论文目录
 
摘要第1-5 页
Abstract第5-8 页
第1章 绪论第8-12 页
　　· 课题来源及研究的目的和意义第8 页
　　· 国内外在该方向的研究现状第8-10 页
　　· 本文主要研究内容第10-11 页
　　· 本文的结构安排第11-12 页
第2章 频率合成理论第12-26 页
　　· 直接数字频率合成器第12-18 页
　　　　· DDS的基本原理第12-13 页
　　　　· 理想情况DDS输出频谱第13-16 页
　　　　· 实际情况DDS输出频谱第16-18 页
　　· 锁相频率合成器第18-21 页
　　　　· 锁相环的数学模型第18-20 页
　　　　· 锁相环的传递函数第20 页
　　　　· 锁相环的噪声性能第20-21 页
　　· DDS＋PLL组合的频率合成器第21-25 页
　　　　· 环外混频式DDS＋PLL频率合成器第22-23 页
　　　　· 环内插入混频DDS＋PLL频率合成器第23-24 页
　　　　· DDS激励PLL的频率合成器第24-25 页
　　· 本章小结第25-26 页
第3章 频率合成器系统设计第26-47 页
　　· 频率合成器的技术指标第26-27 页
　　· 系统设计方案第27-29 页
　　· 系统功能模块设计第29-37 页
　　　　· 参考晶振第30 页
　　　　· DDS芯片第30-32 页
　　　　· 锁相环芯片第32-34 页
　　　　· PLL环路滤波器第34-35 页
　　　　· 压控振荡器第35 页
　　　　· 倍频、上变频及滤波器件第35-37 页
　　· 系统电路设计第37-46 页
　　　　· 系统电路设计方案第37 页
　　　　· 单片机控制模块第37-40 页
　　　　· DDS及低通滤波模块第40-42 页
　　　　· 锁相环模块第42-44 页
　　　　· 键盘及显示模块第44-45 页
　　　　· DDS+PLL模块整体原理图第45-46 页
　　· 本章小结第46-47 页
第4章 设计可行性分析与仿真第47-58 页
　　· 系统部分性能指标分析第47-49 页
　　　　· 系统步进分析第47 页
　　　　· 系统频率稳定度分析第47 页
　　　　· 系统杂散分析第47-49 页
　　· PLL性能的仿真与分析第49-52 页
　　　　· PLL环路稳定性分析与仿真第49-51 页
　　　　· PLL相位噪声分析与仿真第51-52 页
　　· 系统滤波器性能仿真与分析第52-57 页
　　　　· 10MHz低通滤波器仿真与分析第52-54 页
　　　　· 60MHz带通滤波器仿真与分析第54-55 页
　　　　· 微带滤波器仿真与分析第55-57 页
　　· 本章小结第57-58 页
结论第58-59 页
参考文献第59-64 页
致谢第64页

本篇论文共64页，点击这进入下载页面。
 
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