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基于PCIcore的HDLC控制器的FPGA实现
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基于PCIcore的HDLC控制器的FPGA实现
论文目录
 
摘要第1-5 页
ABSTRACT第5-11 页
第一章 概述第11-20 页
　　· 课题研究的内容第11 页
　　· 课题研究的意义第11-12 页
　　· HDLC 控制器的发展及现状第12-19 页
　　　　· HDLC 协议简介和应用现状第12-13 页
　　　　· FPGA 发展及应用现状第13-15 页
　　　　· PCI 介绍和技术发展现状分析第15-19 页
　　· 开发环境第19 页
　　· 本论文的主要工作第19-20 页
第二章 HDLC 控制器的主要原理第20-28 页
　　· 内存的数据结构和数据处理第20-22 页
　　　　· Data Buffer第20 页
　　　　· BD 的定义第20-21 页
　　　　· 发送数据的操作第21-22 页
　　　　· 接收数据的操作第22 页
　　· 中断机制第22-25 页
　　　　· 中断事件第22-23 页
　　　　· 中断相关寄存器第23-24 页
　　　　· 关于中断屏蔽第24 页
　　　　· 中断操作流程第24-25 页
　　· Baud Rate Generator第25-28 页
　　　　· 速率系列第25-27 页
　　　　· 实现方案第27-28 页
第三章 HDLC 控制器的功能设计与总体设计第28-37 页
　　· PCI 总线接口第28-29 页
　　· HDLC Controller第29 页
　　　　· 协议底层支持功能第29 页
　　　　· 其它功能第29 页
　　· DMA Controller第29-30 页
　　· 本地扩展总线接口第30 页
　　· 通道的启动与停止第30-31 页
　　　　· 通道的Hold 与Active 状态第30 页
　　　　· 通道复位寄存器CH＿RSTR第30-31 页
　　　　· 通道启动寄存器CH＿STAR第31 页
　　· HDLC 控制器的结构第31-32 页
　　· FPGA 的引脚定义第32-35 页
　　　　· 串行端口管脚第32-33 页
　　　　· PCI 总线管脚第33-34 页
　　　　· 扩展总线接口第34-35 页
　　· 芯片寄存器分配第35-37 页
　　　　· 通道配置第35-36 页
　　　　· 时隙配置第36 页
　　　　· 全局配置第36-37 页
第四章 HDLC 控制器的电路设计第37-56 页
　　· E1 成帧器第37-38 页
　　· 时隙通道映射第38-40 页
　　· 比特处理第40-42 页
　　　　· 接收方向第40-41 页
　　　　· 发送方向第41-42 页
　　· HDLC 和 Buffer 管理第42-46 页
　　　　· 轮询机制第43 页
　　　　· 内部Buffer 数据结构第43-44 页
　　　　· 接收方向第44-45 页
　　　　· 发送方向第45 页
　　　　· PCI 操作请求第45-46 页
　　　　· 通道Start 控制第46 页
　　· DMA 控制器第46-49 页
　　· Local Master 和 Local Target第49-50 页
　　· 扩展总线和事件统计第50 页
　　· PCI Core第50-56 页
　　　　· IP Core第50-51 页
　　　　· PCI 总线读写时序第51-54 页
　　　　· PCI 的异常操作处理第54-56 页
第五章 HDLC 控制器的测试和验证第56-61 页
　　· 测试目的第56 页
　　· 测试环境第56-58 页
　　· 测试方法第58-61 页
第六章 结论和展望第61-62 页
　　· 结论第61 页
　　· 展望第61-62 页
致谢第62-63 页
参考文献第63-64 页

本篇论文共64页，点击这进入下载页面。
 
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