基于快闪和逐次逼近架构的混合型模数转换器研究



基于快闪和逐次逼近架构的混合型模数转换器研究

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基于快闪和逐次逼近架构的混合型模数转换器研究

论文目录
摘要	第1-6页
ABSTRACT	第6-13页
主要符号对照表	第13-14页
第一章绪论	第14-20页
1.1 研究背景	第14-15页
1.2 模拟数字转换器发展与现状	第15-18页
1.3 本文主要工作和内容安排	第18-20页
第二章模数转换器概述	第20-34页
2.1 模数转换器基本原理	第20页
2.2 模数转换器的性能指标	第20-25页
2.2.1 静态指标	第21-23页
2.2.2 动态特性	第23-25页
2.3 典型模数转换器介绍	第25-30页
2.3.1 快闪模数转换器	第25-27页
2.3.2 逐次逼近模数转换器	第27-28页
2.3.3 时间交织型架构	第28-30页
2.4 混合架构模数转换器	第30-33页
2.4.1 混合流水线和SAR架构	第30-31页
2.4.2 混合Flash和SAR架构	第31-33页
2.4.3 本文ADC架构选择	第33页
2.5 本章小结	第33-34页
第三章电路模块设计分析	第34-52页
3.1 采样保持电路	第34-40页
3.1.1 采样开关	第35-37页
3.1.2 非理想因素分析	第37-40页
3.2 比较器	第40-45页
3.2.1 静态比较器	第40-41页
3.2.2 动态比较器	第41-42页
3.2.3 非理想因素分析	第42-45页
3.3 DAC模块	第45-49页
3.3.1 电容式DAC结构	第46-48页
3.3.2 DAC的噪声和失配	第48-49页
3.4 控制逻辑	第49-51页
3.5 本章小结	第51-52页
第四章模数转换器系统实现	第52-70页
4.1 混合架构低功耗设计	第52-56页
4.2 非二进制电容DAC	第56-59页
4.2.1 信号DAC	第56-58页
4.2.2 参考DAC	第58-59页
4.3 开关自举升压采样电路	第59-61页
4.4 双差分比较器	第61-64页
4.5 数字逻辑设计	第64-69页
4.5.1 改进的TSPC	第65-67页
4.5.2 混合架构专用逻辑	第67-68页
4.5.3 数字时序优化对比	第68-69页
4.6 本章小结	第69-70页
第五章版图仿真与测试	第70-80页
5.1 版图设计	第70-71页
5.1.1 电容阵列版图	第70-71页
5.2 第一版版图和仿真	第71-73页
5.2.1 第一版系统版图	第71-72页
5.2.2 第一版仿真结果	第72-73页
5.3 第一版芯片测试	第73-75页
5.3.1 测试平台设计	第73-75页
5.3.2 测试结果	第75页
5.4 第一版结果分析	第75-76页
5.5 第二版版图和仿真	第76-78页
5.5.1 第二版版图	第76页
5.5.2 第二版仿真结果	第76-78页
5.6 本章小结	第78-80页
第六章总结与展望	第80-82页
6.1 总结	第80-81页
6.2 展望	第81-82页
参考文献	第82-86页
致谢	第86-88页
在读期间发表的学术论文与取得的研究成果	第88页

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