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DSPC50的可测性设计及电路实现
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DSPC50的可测性设计及电路实现
论文目录
 
摘要第1-4 页
Abstract第4-8 页
引言第8-9 页
第一章 集成电路的可测性设计方法的概述第9-16 页
　　· 可测性的改善设计第10 页
　　· 可测性的结构设计第10-13 页
　　　　· 扫描设计的意义第11-12 页
　　　　· 测试向量的施加第12 页
　　　　· 扫描设计的实现方法第12-13 页
　　· 边界扫描设计第13-14 页
　　· 内建自测试电路设计第14-15 页
　　· 小结第15-16 页
第二章 边缘扫描设计第16-35 页
　　· 边缘扫描简介第16-17 页
　　· 边缘扫描测试结构第17-18 页
　　· 边缘扫描测试结构设计第18-31 页
　　　　· 测试存取通道第18-19 页
　　　　· TAP控制器第19-22 页
　　　　· 指令寄存器第22-23 页
　　　　· 数据寄存器第23-29 页
　　　　· TAP控制器的设计第29-31 页
　　· 边缘扫描指令设计第31-33 页
　　　　· 公共指令第31-32 页
　　　　· 专用指令第32-33 页
　　· 边缘扫描测试系统的实现第33-34 页
　　· 小结第34-35 页
第三章 16×16定点乘法器设计与测试生成第35-50 页
　　· 定点数乘法原理第35-39 页
　　　　· 定点数一位乘法第35-38 页
　　　　· 定点补码两位乘第38-39 页
　　· 定点乘法器电路设计第39-44 页
　　　　· 阵列乘法器第39-41 页
　　　　· 布斯阵列乘法器第41-44 页
　　· 乘法器测试生成第44-48 页
　　　　· 故障模型第45-46 页
　　　　· 测试生成第46-48 页
　　· 小结第48-50 页
第四章 SRAM的可测性设计第50-66 页
　　· BIST技术概述第50-53 页
　　　　· 测试向量生成第51 页
　　　　· 测试响应分析第51-52 页
　　　　· 线性反馈移位寄存器第52-53 页
　　· SRAM的功能测试第53-58 页
　　　　· SRAM的基本结构第53 页
　　　　· SRAM的故障类型第53-56 页
　　　　· 各种错误的测试要求第56-58 页
　　· 电路的设计第58-62 页
　　　　· 地址计数器电路第58-61 页
　　　　· 数据发生器电路第61-62 页
　　　　· 响应比较器第62 页
　　· BIST控制器第62-65 页
　　· 小结第65-66 页
结论第66-68 页
致谢第68-69 页
参考文献第69-73 页
附录A 攻读硕士学位期间发表的论文第73-74 页
附录B 乘法器电路第74-75 页
附录C 乘法器行为级硬件语言描述第75-82 页
附录D 乘法器仿真波形图第82 页

本篇论文共82页，点击这进入下载页面。
 
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