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流水线型10-bit高速ADC芯片设计
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流水线型10-bit高速ADC芯片设计
论文目录
 
摘要第1-5 页
Abstract第5-8 页
1 绪论第8-11 页
　　· 研究背景及其意义第8 页
　　· 国内外研究概况及发展趋势第8-9 页
　　· 论文主要工作第9-11 页
　　　　· 预期设计指标第9-10 页
　　　　· 论文内容安排第10-11 页
2 ADC概述第11-24 页
　　· A/D转换器的主要性能指标第11-15 页
　　　　· 理想A/D转换特性第11-12 页
　　　　· 静态性能参数第12-14 页
　　　　· 动态性能参数第14-15 页
　　· 几种典型的A/D转换器及其特点第15-19 页
　　　　· 全并行结构(Flash)第15-16 页
　　　　· 两步(Two-Step Flash)型A/D第16-17 页
　　　　· 流水线型ADC第17-18 页
　　　　· 过采样∑-Δ型ADC第18-19 页
　　· 非理想因素和误差来源第19-24 页
　　　　· 比较器失调第19-20 页
　　　　· 运算放大器的非理想因素第20-22 页
　　　　· 采样时钟抖动第22-23 页
　　　　· 电荷注入和时钟溃通第23-24 页
3 流水线型ADC系统设计第24-37 页
　　· 流水线型ADC的系统结构和工作原理第24-26 页
　　· 1.5bit/stage流水线结构第26-28 页
　　· 1.5bit/stage单级电路的设计第28-37 页
　　　　· 子ADC的设计与实现第28-31 页
　　　　· 子DAC的设计与实现第31-33 页
　　　　· MDAC的设计与实现第33-37 页
4 模块电路的设计与实现第37-59 页
　　· 基准源电路第37-43 页
　　　　· 基准源电路的设计要求第37 页
　　　　· 带隙基准源电路的设计第37-41 页
　　　　· 仿真结果及分析第41-43 页
　　· 过热保护电路第43-45 页
　　　　· 过热保护电路的设计要求第43 页
　　　　· 过热保护电路的设计第43-44 页
　　　　· 仿真结果及分析第44-45 页
　　· 时钟信号电路第45-51 页
　　　　· 时钟电路的设计要求第45 页
　　　　· 环形振荡器和分频电路的设计第45-49 页
　　　　· 仿真结果及分析第49-51 页
　　· 高速动态锁存比较器第51-53 页
　　　　· 比较器的设计要求第51 页
　　　　· 高速动态锁存比较器的设计第51-52 页
　　　　· 仿真结果及分析第52-53 页
　　· 运算放大器第53-57 页
　　　　· 运算放大器的设计要求第53 页
　　　　· 运算放大器的设计第53-57 页
　　　　· 仿真结果及分析第57 页
　　· 数字校正电路第57-59 页
5 电路总体仿真及参数测定第59-66 页
　　· 瞬态响应仿真第59-60 页
　　· 静态参数测定第60-63 页
　　· 动态参数测定第63-65 页
　　· 芯片性能参数总结第65-66 页
6 版图设计第66-69 页
结论第69-70 页
参考文献第70-72 页
攻读硕士学位期间发表学术论文情况第72-73 页
致谢第73-74 页

本篇论文共74页，点击这进入下载页面。
 
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