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低延时高速Turbo码译码器设计
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低延时高速Turbo码译码器设计
论文目录
 
摘要第1-4页
ABSTRACT第4-7页
第一章 绪论第7-11页
　　· 移动通信系统发展概述第7-8页
　　· 信道编码理论第8-9页
　　· TURBO 码的引入第9-10页
　　· 论文结构安排第10-11页
第二章 TURBO 码原理第11-33页
　　· TURBO 码的编码第11-14页
　　　　· TURBO 码的编码结构第11-12页
　　　　· 分量码第12-13页
　　　　· 交织器第13-14页
　　　　· 删余第14页
　　· TURBO 码的译码第14-25页
　　　　· TURBO 码的译码结构第14-15页
　　　　· MAP 算法第15-19页
　　　　· LOG-MAP 算法第19-20页
　　　　· 其它 MAP 类算法简介第20-21页
　　　　· SOVA 算法第21-24页
　　　　· SOVA 类算法简介第24-25页
　　· TURBO 码的性能仿真分析第25-31页
　　　　· TURBO 码仿真平台第25-26页
　　　　· 不同译码算法对 TURBO 码性能的影响第26-27页
　　　　· 不同分量码对 TURBO 码性能的影响第27-28页
　　　　· 不同交织长度对 TURBO 码性能的影响第28-29页
　　　　· 不同编码速率对 TURBO 码性能的影响第29-30页
　　　　· 不同迭代次数对 TURBO 码性能的影响第30-31页
　　　　· TURBO 码设计中参数的选择第31页
　　· 本章小结第31-33页
第三章 高速 TURBO 码设计中关键技术第33-55页
　　· TURBO 码的并行译码第33-36页
　　　　· 并行分块译码结构第33-34页
　　　　· 冗余信息长度的选择第34-35页
　　　　· 分块大小的选择第35-36页
　　· 滑动窗译码算法第36-39页
　　· RADIX-2^X 算法第39-43页
　　　　· RADIX -4 译码算法第40-41页
　　　　· RADIX -8/16 译码算法第41-43页
　　· 其它关键技术简介第43-46页
　　　　· 无冲突交织器第43-44页
　　　　· NII（NEXT ITERATION INTIALIZATION）第44-46页
　　· 低延时高速 TURBO 码设计第46-53页
　　　　· 基本译码参数的选择第46页
　　　　· 高速 TURBO 码译码器译码结构的构造第46-47页
　　　　· 基于比特的无冲突交织器（BCF）设计第47-49页
　　　　· 改进后的译码结构第49-51页
　　　　· 定点量化第51-53页
　　· 本章小结第53-55页
第四章 高速 TURBO 码译码器的硬件设计第55-71页
　　· 高速 TURBO 码译码器的系统架构第55-56页
　　· 顶层模块与时序控制第56-59页
　　· SISO 译码模块设计第59-62页
　　　　· GAMMA 计算模块第59-60页
　　　　· ALPHA、BETA 计算模块第60-62页
　　　　· 对数似然比计算模块第62页
　　· 其它模块简介第62-66页
　　　　· 双口 RAM 存储模块第63-65页
　　　　· 外信息计算模块第65页
　　　　· 交织模块与硬判决模块第65-66页
　　· FPGA 设计综合结果第66-69页
　　· 本章小结第69-71页
第五章 结束语第71-73页
　　· 论文总结第71页
　　· 不足与展望第71-73页
致谢第73-75页
参考文献第75-79页
附录第79-93 页

本篇论文共93页，点击这进入下载页面。
 
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