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ASIC芯片的层次化后端实现
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ASIC芯片的层次化后端实现
论文目录
 
摘要第1-5 页
Abstract第5-6 页
第一章 绪论第6-9 页
　　· ASIC后端设计的发展背景及现状第6-7 页
　　· 课题的来源及特点第7-8 页
　　· 论文的结构安排第8-9 页
第二章 后端设计流程简介第9-19 页
　　· ASIC后端设计标准流程第9-14 页
　　· 后端设计的层次化流程简介第14-17 页
　　· ZSP数字信号处理器测试芯片设计简介第17-19 页
第三章 整体规划与布局第19-36 页
　　· 层次化的设计结构第19-26 页
　　　　· 层次化设计综述第19-20 页
　　　　· 层次化设计的时序约束和时序分析第20-21 页
　　　　· 整体规划第21-23 页
　　　　· 子模块的布局及接口设计第23-26 页
　　· 供电网络的设计分析第26-31 页
　　　　· 影响供电网络设计的因素第26-28 页
　　　　· 供电网络的设计第28-31 页
　　· 标准单元的布局及优化第31-34 页
　　· DFM及设计规则的考虑第34-36 页
第四章 时钟树综合及优化第36-47 页
　　· 时钟树综合原理简介第36-39 页
　　　　· 时钟偏斜第36-37 页
　　　　· 时钟树综合第37-39 页
　　· 层次化设计中时钟树的综合第39-41 页
　　· 时钟树的优化及时序收敛第41-47 页
　　　　· 时钟树的优化第41-42 页
　　　　· 时钟树综合后的时序分析和优化第42-47 页
　　　　　　· 时序分析第42-43 页
　　　　　　· 时序优化第43-47 页
第五章 布线及串扰问题的影响第47-56 页
　　· 自动布线原理简介第47-50 页
　　　　· 自动布线原理第47-48 页
　　　　· Astro布线流程第48-49 页
　　　　· 布线设置和优化第49-50 页
　　· 层次化设计的布线第50-52 页
　　· 串扰问题对时序的影响及其优化第52-56 页
　　　　· 串扰对时序的影响第52-53 页
　　　　· 串扰的预防和优化第53-56 页
第六章 静态时序分析第56-63 页
　　· 静态时序分析原理第56-57 页
　　· 层次化设计的静态时序分析第57-59 页
　　　　· 层次化的设置第57-58 页
　　　　· 分析模式第58-59 页
　　　　· 分析阶段第59 页
　　· 静态时序分析后的时序优化第59-63 页
　　　　· 层次化设计中接口部分的时序优化第60-61 页
　　　　· 签付时序优化第61-63 页
第七章 工程变更的方法及应用第63-67 页
　　· 设计功能变更第63-66 页
　　　　· 备用门单元的使用第63-64 页
　　　　· 网表的改变第64-66 页
　　· 时序变更第66-67 页
第八章 总结第67-69 页
参考文献第69-71 页
致谢第71-72 页

本篇论文共72页，点击这进入下载页面。
 
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