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无线接入SOC芯片的低功耗物理设计
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无线接入SOC芯片的低功耗物理设计
论文目录
 
中文摘要第1-5 页
Abstract第5-10 页
第一章 绪论第10-14 页
· 集成电路产业发展的现状第10-11 页
· 低功耗技术的研究意义第11-12 页
· 本文研究的内容和意义第12-14 页
第二章 低功耗技术研究第14-29 页
· 功耗的发展现状第14-15 页
· 功耗的分类第15-19 页
· 动态功耗第15-18 页
· 静态功耗第18-19 页
· 功耗优化技术第19-28 页
· 算法级低功耗设计第20-21 页
· 体系结构级低功耗设计第21 页
· 寄存器传输级的低功耗设计第21-24 页
· 逻辑门级低功耗设计第24-25 页
· 晶体管级低功耗设计第25-26 页
· 静态功耗优化方法第26-28 页
· 低功耗技术的应用第28-29 页
第三章 无线接入 SOC 芯片的低功耗综合策略研究第29-41 页
· 无线接入芯片概述第29-30 页
· Power Compiler 功耗计算的原理第30-35 页
·R TL 级功耗估计第32-35 页
· 无线接入SOC 芯片的低功耗逻辑综合流程第35-38 页
· 门控技术功耗优化第35-36 页
· PowerCompiler 低功耗综合的约束条件第36-38 页
· 无线接入芯片低功耗综合结果第38-40 页
· 本章小结第40-41 页
第四章 无线接入 SOC 芯片的低功耗物理实现的研究第41-64 页
· 总体流程及选用的EDA 工具第41-42 页
· FloorPlan 阶段的工作第42-46 页
· floorPlan 阶段的主要工作第42-43 页
· 布局阶段的低功耗设计方法研究第43-46 页
· 标准单元摆放阶段的工作第46-47 页
· 标准单元摆放要完成的工作第46 页
· 标准单元摆放的功耗考虑第46-47 页
· 时钟树综合阶段的工作第47-53 页
· 时钟树综合完成的工作第47-50 页
· 时钟树综合阶段的功耗优化策略第50-53 页
· 布线(Routing)阶段的工作第53-56 页
· 全局布线和详细布线所做的工作第53-55 页
· 布线中的功耗优化策略第55-56 页
· 寄生参数提取和延迟计算第56-57 页
· 电源分析和功耗分析第57-60 页
· 设计规则检查（DRC）第60-61 页
· LVS（Layout Versus Schematic）验证第61-62 页
· 本章小结第62-64 页
第五章 总结与展望第64-66 页
参考文献第66-69 页
致谢第69页

本篇论文共69页，点击这进入下载页面。
 
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